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常規(guī)PLL電路原理圖，摘自《CS8416 Datasheet》， Cirrus Logic, Inc. AUGUST ’07.
通過仔細的設(shè)計和元器件的選擇， PLL可以實現(xiàn)很好的時鐘跟蹤的性能，并控制Jitter（時基抖動）在較小的水平。但是， PLL電路的性能容易受信號質(zhì)量、傳送線路質(zhì)量、器材、干擾和速度等因素的影響，在高速的狀態(tài)下性能受限制。
ESS公司使用了異步采樣率轉(zhuǎn)換的技術(shù) ，通過適當(dāng)?shù)挠嬎?nbsp;，使DAC的時鐘與音頻信號時鐘保持一致但與暫態(tài)變化脫離，芯片使用本地產(chǎn)生的時鐘信號， DAC的Jitter僅取決于本地晶振的固有性能，實質(zhì)性地來消除信號中和傳輸中的Jitter ，降低對前端信號質(zhì)量、連接線、器材等的要求。ESS公司Sabre DAC的SPDIF接口能夠達到很寬裕的Jitter容忍度。
Sabre DAC的Jitter消除電路原理圖，摘自《 About Jitter》AMM ESS, October 2011;
芯片不同時鐘來源比較
2）HyperStream調(diào)制器
ESS公司的低階級聯(lián)的調(diào)制器，稱為HyperStream調(diào)制器，使調(diào)制深度接近100% ，并且保持調(diào)制器穩(wěn)定，從而降低Sigma-Delta DAC的暫態(tài)（頻域）非線性和噪聲。
3）過采樣率倍增器（OSR Doubler）
Sigma-Delta DAC都采用過采樣技術(shù)來擴大動態(tài)范圍，再通過噪聲整形來降低音頻頻帶內(nèi)噪聲。早期的DAC芯片的過采樣頻率還在較低的水平，如4~16倍的標(biāo)準(zhǔn)音頻采樣頻率，現(xiàn)在的芯片可以做到更高的頻率，來進一步提高DAC的性能。日本AKM公司，在數(shù)字濾波中采用過采樣率倍增器（OSR Doubler），來增加輸入信號的范圍、降低音頻帶內(nèi)噪聲、同時降低功耗，其高端DAC芯片如AK4490等，過采樣倍數(shù)可達到256倍。
4）分段DAC
按所處的位置和所起作用的不同，分段數(shù)字信號高位和低位，再有目的地分別進行處理，可以提高DAC的性能。Texas Instruments在PCM179x和DSD179x系列等芯片中采用了這項技術(shù) ，稱為“先進分段DAC” ，來增加動態(tài)范圍和提高對Jitter的容忍度。
Texas Instruments的“先進分段DAC”原理圖，摘自《DSD1794A Datasheet》Texas Instruments, NOVEMBER 2006
5）其它技術(shù)
為了盡可能地改善音頻DAC芯片的性能，廠商還會采取其它一些的技術(shù) ，如：數(shù)據(jù)加權(quán)平均（DWA）、增益矯正和失真補償、基準(zhǔn)參考電壓矯正、電流輸出、低輸出阻抗、差分互補輸出、外部數(shù)字濾波、低噪聲線性電源，等等。技術(shù)手段是多樣的，且有些技術(shù)還處于保密之中，因此也難以一一羅列和描述。
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高端音頻DAC芯片排名
動態(tài)范圍是音頻DAC有代表性的性能參數(shù) ，以下就按此性能高低并結(jié)合其它因素，對最高端部分的音頻DAC芯片進行排名。
高端音頻DAC芯片排名：
注：動態(tài)范圍數(shù)據(jù)為各廠商公布的各對應(yīng)芯片的最大值。排名未包括應(yīng)用導(dǎo)向（如含有模擬放大器SoC）、獨立調(diào)制器、獨立數(shù)模轉(zhuǎn)換器和停產(chǎn)的等芯片。
ESS公司的ES9038PRO作為目前為止行業(yè)內(nèi)參數(shù)指標(biāo)最高的芯片之一，片上集成了SPDIF接口，通過采用采樣率的異步轉(zhuǎn)換技術(shù)的Jitter消除電路，與前端傳輸Jitter去耦合，有很大的Jitter容忍度， HyperStream專利調(diào)制器能使Sigma-Delta調(diào)制器克服一些頻域暫態(tài)的非常線性，外加其它的一些技術(shù) ，如失真矯正、8通道可隨意切換的差分DAC、專用的超低噪聲線性電源（ES9311Q）等，作為性能最好的芯片，有許多的優(yōu)勢。

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